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Keybot 568 Results  www.analog.com  Page 5
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AD9445 105-/125-MSPS 14-Bit, 5-/3.3-V, Buffered ADC
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AD9446 ：16ビット、80/100MSPS、バッファ付きADC
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Is the ADC internally buffered?
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アンプは長い距離にわたって駆動できるため、システム分割によって複数のボードが設計で要求されるときに特に便利である。
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Figure 9. Typical input impedance graph of a switched-capacitor ADC in track mode.
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に外部ネットワークをマッチングさせることが重要です。この図でわかるように、入力インピーダンスの実数部すなわち抵抗部（青線）は、低周波（ベースバンド）で非常に高くなり（数キロオームのレンジ）、100MHzを超えると2kW未満に減衰します。
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When choosing an ADC, always remember:
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アンプは本質的に出力負荷の影響から入力信号源を分離しているため、影響を受けやすい入力信号源を取り扱う場合、トランスよりも便利である。
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AD9446 16-Bit, 80-/100-MSPS Buffered ADC
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AD8138 ：低歪み差動ADCドライバ
  Switching Bits | Analog...  
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Like any other component in the signal chain, ADCs have their own thermal noise contribution. Thus, if you want to verify that the ADC is behaving as expected with no input signal, you need to capture a block of data and average it, just as the DVM does with the amplifier circuit.
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高速A/D コンバータ（ADC） に慣れていない人は、アナログ 入力が静的であったらコンバー タのデジタル出力は一定になる と思うかもしれません。これ は、入力信号がないオペアン プの出力に単純なDC オフセッ ト誤差を予想するようなもので す。アンプ回路の入力信号を取り除 き、デジタル電圧計（DVM）で出力電 圧を測定すれば、アンプのオフセットが表示され ます。しかし、DVM は表示された結果を平均処 理しているので（しかもADC を使って！）、アン プの出力におけるノイズは不明です。ノイズの測 定には、オッシロスコープまたはスペクトル・ア ナライザが必要です。
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Like any other component in the signal chain, ADCs have their own thermal noise contribution. Thus, if you want to verify that the ADC is behaving as expected with no input signal, you need to capture a block of data and average it, just as the DVM does with the amplifier circuit.
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高速A/D コンバータ（ADC） に慣れていない人は、アナログ 入力が静的であったらコンバー タのデジタル出力は一定になる と思うかもしれません。これ は、入力信号がないオペアン プの出力に単純なDC オフセッ ト誤差を予想するようなもので す。アンプ回路の入力信号を取り除 き、デジタル電圧計（DVM）で出力電 圧を測定すれば、アンプのオフセットが表示され ます。しかし、DVM は表示された結果を平均処 理しているので（しかもADC を使って！）、アン プの出力におけるノイズは不明です。ノイズの測 定には、オッシロスコープまたはスペクトル・ア ナライザが必要です。
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AD9246, 80-/105-/125-MSPS 14-Bit, 1.8-V, Switched-Capacitor ADC
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AD9445 ：105/125MSPS、14ビット、5/3.3V、バッファ付きADC
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Figure 10. Single-ended measurement of a switched-capacitor ADC input relative to the clock edges.
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この入力構造にマッチングさせることは、特に100MHzを超える周波数では、かなり困難な設計課題になります。
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Like any other component in the signal chain, ADCs have their own thermal noise contribution. Thus, if you want to verify that the ADC is behaving as expected with no input signal, you need to capture a block of data and average it, just as the DVM does with the amplifier circuit.
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高速A/D コンバータ（ADC） に慣れていない人は、アナログ 入力が静的であったらコンバー タのデジタル出力は一定になる と思うかもしれません。これ は、入力信号がないオペアン プの出力に単純なDC オフセッ ト誤差を予想するようなもので す。アンプ回路の入力信号を取り除 き、デジタル電圧計（DVM）で出力電 圧を測定すれば、アンプのオフセットが表示され ます。しかし、DVM は表示された結果を平均処 理しているので（しかもADC を使って！）、アン プの出力におけるノイズは不明です。ノイズの測 定には、オッシロスコープまたはスペクトル・ア ナライザが必要です。
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Amplifiers can also provide dynamic isolation, roughly 30 dB to 40 dB of reverse isolation, to squelch kickback glitches from current transients in an unbuffered ADC’s input.
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です。トランスは、PCボード上の長いパターンを駆動するように作られたものではなく、ADCに直接接続することを想定しています。「ドライバ／カプラ」をADCから離れたところや別のボードに配置するようシステム要件に記述されている場合、アンプを強く推奨します。
  Slow Starting ADCs | An...  
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Alexei, whom I met at a seminar in Novosibirsk in Siberia, was no exception. He complained that his ADC (analog-to-digital converter) was badly out of specification and sometimes did not work at all, but was reluctant to provide details of his system.
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安全保障に執着していたソビエト体制の副産物で、ロシア人はアプリケーションの問題があっても、詳しい内容を人に教えるのをどうしても嫌がることがあります。シベリアのノボシビルスクで開催されたセミナーで出会ったアレクセイも例外ではありませんでした。彼のADコンバータが仕様をひどく逸脱し、場合によっては全く動作しなくなることもあると言うのです。けれども、システムの詳細を話そうとしてくれません。そこで、私はいくらかのウォッカとキャビアとブリニをごちそうし、母なるロシア、女帝エカテリーナ、シベリア横断鉄道、世界中のアナログ・エンジニアのために乾杯しました。そこでやっと彼は打ち解けて、実はADCを起動するのは変換する間だけで、その後は電源をシャットダウンしていると教えてくれました。
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Alexei, whom I met at a seminar in Novosibirsk in Siberia, was no exception. He complained that his ADC (analog-to-digital converter) was badly out of specification and sometimes did not work at all, but was reluctant to provide details of his system.
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安全保障に執着していたソビエト体制の副産物で、ロシア人はアプリケーションの問題があっても、詳しい内容を人に教えるのをどうしても嫌がることがあります。シベリアのノボシビルスクで開催されたセミナーで出会ったアレクセイも例外ではありませんでした。彼のADコンバータが仕様をひどく逸脱し、場合によっては全く動作しなくなることもあると言うのです。けれども、システムの詳細を話そうとしてくれません。そこで、私はいくらかのウォッカとキャビアとブリニをごちそうし、母なるロシア、女帝エカテリーナ、シベリア横断鉄道、世界中のアナログ・エンジニアのために乾杯しました。そこでやっと彼は打ち解けて、実はADCを起動するのは変換する間だけで、その後は電源をシャットダウンしていると教えてくれました。
  Impedance Measurement M...  
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The AD59338 fully integrated single-chip impedance analyzer (Figure 1) is a high-precision impedance-converter system that combines an on-board frequency generator with a 12-bit, 1 MSPS, analog-to-digital converter (ADC).
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血液サンプルのデリバリー装置と計測機器とのインターフェースは重要です。この場合、血液サンプルが送られる特殊なマイクロ流体チャンネルは、AD5933計測回路に接続するように設計されました（図3）。マイクロ流体デバイスは3つの層から構成されます。最下層は、2つのスクリーン印刷された電極から構成され、AD5933回路の入出力ポート・ピンに接続されました。最上部のマイクロモールドされたポリマー・チャンネルは、マイクロチャンネルで接続された2つの容器から構成されます。凝固反応を起こす化学試薬は、このマイクロチャンネル内または中央ボンディング層上に格納できます。最上部と最下部のチャンネルは、感圧性接着剤（PSA）を用いて結合されます。1つの容器に入れられた血液サンプルが、マイクロチャンネルを満たします。これにより、スクリーン印刷されAD5933回路に接続された電極と接触します。
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The AD59338 fully integrated single-chip impedance analyzer (Figure 1) is a high-precision impedance-converter system that combines an on-board frequency generator with a 12-bit, 1 MSPS, analog-to-digital converter (ADC).
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血液サンプルのデリバリー装置と計測機器とのインターフェースは重要です。この場合、血液サンプルが送られる特殊なマイクロ流体チャンネルは、AD5933計測回路に接続するように設計されました（図3）。マイクロ流体デバイスは3つの層から構成されます。最下層は、2つのスクリーン印刷された電極から構成され、AD5933回路の入出力ポート・ピンに接続されました。最上部のマイクロモールドされたポリマー・チャンネルは、マイクロチャンネルで接続された2つの容器から構成されます。凝固反応を起こす化学試薬は、このマイクロチャンネル内または中央ボンディング層上に格納できます。最上部と最下部のチャンネルは、感圧性接着剤（PSA）を用いて結合されます。1つの容器に入れられた血液サンプルが、マイクロチャンネルを満たします。これにより、スクリーン印刷されAD5933回路に接続された電極と接触します。
  Wideband A/D Converter ...  
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For example, transformer characteristics change over frequency, thus complicating the model. An example of a starting point for modeling a transformer for ADC applications can be seen in Figure 6. Each of the parameters will depend on the transformer chosen.
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「スプリアス・フリー・ダイナミック・レンジ（SFDR）」は、フルスケールのRMS値と、最大スプリアス・スペクトル成分のRMS値との比です。フロントエンドにおけるスプリアスの2つの大きな要因は、主として2次高調波歪みを生成するアンプの非直線性（すなわちトランスの完全な平衡の欠如）と、入力ミスマッチおよびゲインによるその増幅であり（高ゲインになるほどマッチングは難しくなり、寄生非直線性は増幅されます）、通常、3次高調波歪みと見なされます。
  Wideband A/D Converter ...  
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If the design calls for wideband gain, an amplifier provides a better match than a transformer to the ADC’s analog inputs.
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DC結合であることもアンプを使用する理由になります。トランスは本質的にAC結合であるからです。高周波アンプは、DCに至るまでのすべての周波数で結合できます（スペクトルのその部分がアプリケーションにおいて重要である場合）。検討すべき標準的なアンプとして、AD8138とADA4937があります。
  Complete Sensor-to-Bits...  
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An auxiliary differential input channel can accommodate ±4.096 V input signals. It bypasses the multiplexer and PGIA stages, allowing direct interface to the 16-bit SAR ADC. An on-chip temperature sensor can monitor the local temperature.
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表1では、ADAS3022とディスクリート・シグナル・チェーンのノイズ性能を比較しています。この表に示すシグナル・チェーン全体の総合ノイズは、各部品の入力信号振幅、ゲイン、等価ノイズ帯域幅（ENBW）、入力換算ノイズ（RTI）を使って計算しました。
  Watch for Those Multipl...  
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As an example, let's take two outputs of the AD9516 clock generator. One output, at 100 MHz, is connected to an ADC; the other, at 25 MHz (1/4×fSAMPLE), clocks an FPGA. Rising and falling edges occur on both output clocks at nearly the same time.
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一例として、AD9516クロック・ジェネレータからの2つの出力をみてみましょう。1つの出力は100MHzでADコンバータに接続され、もう1つは25MHz（1/4×fSAMPLE）でFPGAのクロックとして使用されます。立上がりエッジと立下がりエッジは、ほぼ同時に両方の出力クロックで発生します。高速で移動する広帯域幅を持つエッジが、不都合なことに10nsごとに2回発生するため、カップリング効果が生じます。この遷移期間中は、内部ノイズまたは外部からのノイズを低く抑える必要があります。クロックの遷移期間にジッタまたはノイズが存在すると、そのときだけADCのタイミングが損なわれる可能性があります。スルーレートを速くしてエッジの速度を上げれば、スレッショールド領域は小さくなるので、スレッショールド期間にノイズが存在する時間も必然的に短くなります。その結果、システムに生じるRMS（実効値）のジッタが効果的に低減されます。クロックが定常状態（ローレベルまたはハイレベル状態）を維持していれば、クロックのノイズは特に関係ありません。したがって、単に25MHzクロックと100MHzクロックのいずれか一方を遅延させるだけで、それらは時間的に分離されるため、干渉の位置も変わります。要するに、一方のクロックの遷移エッジを、他方のクロックの定常状態期間に生じるよう調整する必要があります。
  Wideband A/D Converter ...  
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To make better use of the ADC’s SNR, a filter is inserted between the amplifier and ADC. With a 100-MHz 2-pole filter, the amplifier’s integrated noise becomes 71 µV rms, degrading the ADC’s SNR by only 3 dB.
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A. アンプの性能は、トランスと比べてほとんど制限がありません。またDCレベルの保持が必要な場合は、アンプを使用する必要があります。トランスは本質的にAC結合のデバイスであるからです。トランスは必要に応じてガルバニック絶縁が可能です。アンプは出力インピーダンスが本質的にゲインとは無関係であるため、より簡単にゲインを得ることができます。それに対して、トランスの出力インピーダンスは、電圧ゲイン（巻線比によって決定）の2乗に応じて増大します。アンプを使用するとパスバンドの応答が平坦になり、トランスの寄生的な相互作用によるリップルがありません。
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To make better use of the ADC’s SNR, a filter is inserted between the amplifier and ADC. With a 100-MHz 2-pole filter, the amplifier’s integrated noise becomes 71 µV rms, degrading the ADC’s SNR by only 3 dB.
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A. アンプの性能は、トランスと比べてほとんど制限がありません。またDCレベルの保持が必要な場合は、アンプを使用する必要があります。トランスは本質的にAC結合のデバイスであるからです。トランスは必要に応じてガルバニック絶縁が可能です。アンプは出力インピーダンスが本質的にゲインとは無関係であるため、より簡単にゲインを得ることができます。それに対して、トランスの出力インピーダンスは、電圧ゲイン（巻線比によって決定）の2乗に応じて増大します。アンプを使用するとパスバンドの応答が平坦になり、トランスの寄生的な相互作用によるリップルがありません。
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To make better use of the ADC’s SNR, a filter is inserted between the amplifier and ADC. With a 100-MHz 2-pole filter, the amplifier’s integrated noise becomes 71 µV rms, degrading the ADC’s SNR by only 3 dB.
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A. アンプの性能は、トランスと比べてほとんど制限がありません。またDCレベルの保持が必要な場合は、アンプを使用する必要があります。トランスは本質的にAC結合のデバイスであるからです。トランスは必要に応じてガルバニック絶縁が可能です。アンプは出力インピーダンスが本質的にゲインとは無関係であるため、より簡単にゲインを得ることができます。それに対して、トランスの出力インピーダンスは、電圧ゲイン（巻線比によって決定）の2乗に応じて増大します。アンプを使用するとパスバンドの応答が平坦になり、トランスの寄生的な相互作用によるリップルがありません。
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As an example, let's take two outputs of the AD9516 clock generator. One output, at 100 MHz, is connected to an ADC; the other, at 25 MHz (1/4×fSAMPLE), clocks an FPGA. Rising and falling edges occur on both output clocks at nearly the same time.
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一例として、AD9516クロック・ジェネレータからの2つの出力をみてみましょう。1つの出力は100MHzでADコンバータに接続され、もう1つは25MHz（1/4×fSAMPLE）でFPGAのクロックとして使用されます。立上がりエッジと立下がりエッジは、ほぼ同時に両方の出力クロックで発生します。高速で移動する広帯域幅を持つエッジが、不都合なことに10nsごとに2回発生するため、カップリング効果が生じます。この遷移期間中は、内部ノイズまたは外部からのノイズを低く抑える必要があります。クロックの遷移期間にジッタまたはノイズが存在すると、そのときだけADCのタイミングが損なわれる可能性があります。スルーレートを速くしてエッジの速度を上げれば、スレッショールド領域は小さくなるので、スレッショールド期間にノイズが存在する時間も必然的に短くなります。その結果、システムに生じるRMS（実効値）のジッタが効果的に低減されます。クロックが定常状態（ローレベルまたはハイレベル状態）を維持していれば、クロックのノイズは特に関係ありません。したがって、単に25MHzクロックと100MHzクロックのいずれか一方を遅延させるだけで、それらは時間的に分離されるため、干渉の位置も変わります。要するに、一方のクロックの遷移エッジを、他方のクロックの定常状態期間に生じるよう調整する必要があります。
  Dual Difference Amplifi...  
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Figure 2. Differential amplifier drives ADC.
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低入力範囲でADCを駆動するため、AD8270のゲイン・ブロックを変更して、1未満のゲインを供給することができます。この例を図3に示します。
  Things are not always w...  
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16-Bit, 1 MSPS PulSAR® ADC in MSOP/QFN
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プロセス・コントロール＆産業用オートメーション
  Resolution vs. ENOB | A...  
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As my friend and I reminisced about a few of the old winners and losers, I remembered having just answered a customer’s question about an ADC’s effective number of bits (ENOB). ENOB is based on the equation for an ideal ADC’s SNR: SNR = 6.02 × N + 1.76 dB, where N is the ADC’s resolution.
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私と友人は昔の製品の「勝組」と「負組」についてちょっと思い出話をしましたが、そのとき私はA/Dコンバータの有効ビット数（ENOB）に関してユーザーからの質問に答えたことを思い出しました。ENOBは、SNR = 6.02 × N + 1.76dBという理想的なADCのS/N比（SNR）の式に基づいています。この式のNはADCの分解能です。現実世界のADCはそれ自体にノイズと誤差があるため、このようなSNRを達成することはありません。ADCの有効な値N（一般にENOBと呼ばれています）を計算するには、上述の式を書き換えて、ENOB = (SNR – 1.76) / 6.02dBとします。対象となっているデバイスは12ビットADCですが、そのENOBはわずか10.5。ご質問者はたいへん礼儀正しい方でしたが、性能が1.5ビットも違うのに12ビット分解能と仕様に書くのは不適切ではないかと指摘しなければいけないと思われたようです。このデバイスは500MSPSで動作し、所要の消費電力からすればかなり高速でした。この方は分解能の記述を誇張したのかどうか私に答えるよう迫りました。まるで、私たちがルール違反を犯したかのように！ 私は、ルールは直線性であり、この点でルールに違反していないと説明しました。コンバータの微分直線性の仕様は分解能の1LSB未満でなければなりません。また、コンバータの積分直線性によって歪み性能が決まるので、コンバータの分解能が高いと達成できるSFDRも高くなります。
  Driving Miss ADC | Anal...  
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Don't panic. ADC inputs may indeed be unfriendly, but they can be tamed. You'll need a good driver, though.
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アナログ・デバイセズのFacebookアカウント（英語版）では、さまざまな情報が入手できます。是非フォローしてみてください。
  High-Performance Multic...  
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Beyond the ADC
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アンプの選択
  Resolution vs. ENOB | A...  
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As my friend and I reminisced about a few of the old winners and losers, I remembered having just answered a customer’s question about an ADC’s effective number of bits (ENOB). ENOB is based on the equation for an ideal ADC’s SNR: SNR = 6.02 × N + 1.76 dB, where N is the ADC’s resolution.
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私と友人は昔の製品の「勝組」と「負組」についてちょっと思い出話をしましたが、そのとき私はA/Dコンバータの有効ビット数（ENOB）に関してユーザーからの質問に答えたことを思い出しました。ENOBは、SNR = 6.02 × N + 1.76dBという理想的なADCのS/N比（SNR）の式に基づいています。この式のNはADCの分解能です。現実世界のADCはそれ自体にノイズと誤差があるため、このようなSNRを達成することはありません。ADCの有効な値N（一般にENOBと呼ばれています）を計算するには、上述の式を書き換えて、ENOB = (SNR – 1.76) / 6.02dBとします。対象となっているデバイスは12ビットADCですが、そのENOBはわずか10.5。ご質問者はたいへん礼儀正しい方でしたが、性能が1.5ビットも違うのに12ビット分解能と仕様に書くのは不適切ではないかと指摘しなければいけないと思われたようです。このデバイスは500MSPSで動作し、所要の消費電力からすればかなり高速でした。この方は分解能の記述を誇張したのかどうか私に答えるよう迫りました。まるで、私たちがルール違反を犯したかのように！ 私は、ルールは直線性であり、この点でルールに違反していないと説明しました。コンバータの微分直線性の仕様は分解能の1LSB未満でなければなりません。また、コンバータの積分直線性によって歪み性能が決まるので、コンバータの分解能が高いと達成できるSFDRも高くなります。
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As my friend and I reminisced about a few of the old winners and losers, I remembered having just answered a customer’s question about an ADC’s effective number of bits (ENOB). ENOB is based on the equation for an ideal ADC’s SNR: SNR = 6.02 × N + 1.76 dB, where N is the ADC’s resolution.
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私と友人は昔の製品の「勝組」と「負組」についてちょっと思い出話をしましたが、そのとき私はA/Dコンバータの有効ビット数（ENOB）に関してユーザーからの質問に答えたことを思い出しました。ENOBは、SNR = 6.02 × N + 1.76dBという理想的なADCのS/N比（SNR）の式に基づいています。この式のNはADCの分解能です。現実世界のADCはそれ自体にノイズと誤差があるため、このようなSNRを達成することはありません。ADCの有効な値N（一般にENOBと呼ばれています）を計算するには、上述の式を書き換えて、ENOB = (SNR – 1.76) / 6.02dBとします。対象となっているデバイスは12ビットADCですが、そのENOBはわずか10.5。ご質問者はたいへん礼儀正しい方でしたが、性能が1.5ビットも違うのに12ビット分解能と仕様に書くのは不適切ではないかと指摘しなければいけないと思われたようです。このデバイスは500MSPSで動作し、所要の消費電力からすればかなり高速でした。この方は分解能の記述を誇張したのかどうか私に答えるよう迫りました。まるで、私たちがルール違反を犯したかのように！ 私は、ルールは直線性であり、この点でルールに違反していないと説明しました。コンバータの微分直線性の仕様は分解能の1LSB未満でなければなりません。また、コンバータの積分直線性によって歪み性能が決まるので、コンバータの分解能が高いと達成できるSFDRも高くなります。
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